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（通用）集成電路崗位職責(zé)14篇
在不斷進(jìn)步的時(shí)代，接觸到崗位職責(zé)的地方越來(lái)越多，崗位職責(zé)主要強(qiáng)調(diào)的是在工作范圍內(nèi)所應(yīng)盡的責(zé)任。我們?cè)撛趺粗贫◢徫宦氊?zé)呢？以下是小編整理的集成電路崗位職責(zé)，希望對(duì)大家有所幫助。
集成電路崗位職責(zé)1
崗位職責(zé):
1、 負(fù)責(zé)根據(jù)designer提供的schematic創(chuàng)建模擬與混合信號(hào)ic晶體管級(jí)版圖設(shè)計(jì);
2、 通過drc和lvs對(duì)版圖進(jìn)行驗(yàn)證和優(yōu)化;
3、 與designer精密合作與溝通,對(duì)版圖的'結(jié)構(gòu)和布局有準(zhǔn)確性地理解。
任職要求:
1、 微電子等相關(guān)專業(yè),本科學(xué)歷;
2、 熟練掌握版圖設(shè)計(jì)工具cadence virtuoso/laker設(shè)計(jì)流程,及版圖驗(yàn)證drc和lvs工作使用流程;
3、 能夠讀懂foundry提供的design rule等文件;
4、 有cmos圖像傳感器設(shè)計(jì)版圖,了解ic工藝制作流程者優(yōu)先考慮;
5、 態(tài)度積極主動(dòng),有團(tuán)隊(duì)合作精神。
集成電路崗位職責(zé)2
職責(zé)描述:
1. 負(fù)責(zé)產(chǎn)品架構(gòu)設(shè)計(jì)
2. 按照產(chǎn)品定義完成ip設(shè)計(jì)及系統(tǒng)設(shè)計(jì)
3. 配合fpga進(jìn)行系統(tǒng)調(diào)試
4. 參與數(shù)字電路的.仿真驗(yàn)證
5. 參與芯片的數(shù)字流程
6. 編寫ip及產(chǎn)品文檔
任職要求:
1. 電子工程,計(jì)算機(jī)或微電子等專業(yè),本科以上學(xué)歷
2. 在數(shù)字設(shè)計(jì)領(lǐng)域有5年以上工作經(jīng)驗(yàn)
3. 熟悉verilog hdl語(yǔ)言,熟悉arm,amba總線及常用ip的原理
4. 熟悉常用的eda工具
5. 具有arm soc芯片或者mcu項(xiàng)目經(jīng)驗(yàn)
6. 具有芯片成功流片經(jīng)驗(yàn)
7. 具有團(tuán)隊(duì)精神,責(zé)任感,積極主動(dòng),溝通能力強(qiáng)
集成電路崗位職責(zé)3
崗位職責(zé):
1、基于cmos工藝的射頻收發(fā)芯片的電路和系統(tǒng)設(shè)計(jì),制定各模塊性能指標(biāo)和實(shí)現(xiàn)方案;
2、獨(dú)立進(jìn)行射頻電路模塊的設(shè)計(jì),其中包括電路結(jié)構(gòu)的'確立、行為級(jí)和電路級(jí)的仿真、電路的實(shí)現(xiàn)和芯片的測(cè)試,并指導(dǎo)系統(tǒng)級(jí)射頻應(yīng)用。
3、根據(jù)規(guī)范設(shè)計(jì)射頻集成電路諸如lna、 mixer、pll、 vco, filter, vga,ad da和pa等。
4、根據(jù)系統(tǒng)要求將各個(gè)功能模塊集成為soc系統(tǒng)。
5、根據(jù)電路要求指導(dǎo)版圖工程師進(jìn)行版圖設(shè)計(jì)。
6、根據(jù)設(shè)計(jì)結(jié)果完成設(shè)計(jì)文檔和測(cè)試計(jì)劃。
7、芯片功能模塊和系統(tǒng)測(cè)試、性能評(píng)估和問題分析。
任職要求:
1、微電子學(xué),半導(dǎo)體或相關(guān)專業(yè)碩士及以上學(xué)歷。
2、有l(wèi)na、 mixer、pll、vco、pa, filter,vga, ad,da等模塊的設(shè)計(jì)經(jīng)驗(yàn)優(yōu)先。
3、熟練掌握電路原理基礎(chǔ)知識(shí),了解反饋理論及其應(yīng)用。
4、能正確分析諸如運(yùn)放,功放,混頻器等集成單元電路。
5、熟練使用cadence集成電路設(shè)計(jì)環(huán)境。
6、會(huì)用電路仿真軟件建立正確的仿真測(cè)試平臺(tái)并正確分析電路仿真結(jié)果。
7、良好的團(tuán)隊(duì)合作精神,工作敬業(yè)負(fù)責(zé)。
集成電路崗位職責(zé)4
崗位描述：
1、產(chǎn)品的電路設(shè)計(jì)、調(diào)試和優(yōu)化;
2、對(duì)電路系統(tǒng)的性能測(cè)試,驗(yàn)證可靠性;
3、電路元器件的'選型認(rèn)證，編寫設(shè)計(jì)文檔。
4、為客戶提供技術(shù)培訓(xùn)，并解決客戶遇到的技術(shù)問題;
5、通過和客戶溝通，推薦公司的合適產(chǎn)品并尋找新的應(yīng)用項(xiàng)目;
6、幫助用戶完成基于我公司代理產(chǎn)品的規(guī)劃和調(diào)試;
7、對(duì)公司內(nèi)部員工進(jìn)行技術(shù)培訓(xùn)。
任職資格：
1、電子電氣及相關(guān)專業(yè)畢業(yè)，專科及以上學(xué)歷;英語(yǔ)良好;
2、2年以上相關(guān)工作經(jīng)歷;
3、具備電氣、電子原材料的知識(shí);熟練使用protel，cadense等軟件;精通各種電路。能熟練使用示波器等常用的儀器儀表，熟悉電氣標(biāo)準(zhǔn);
4、有較強(qiáng)的責(zé)任心,良好團(tuán)隊(duì)協(xié)作能力、溝通能力、善于學(xué)習(xí)。
集成電路崗位職責(zé)5
職責(zé)描述:
1、負(fù)責(zé)算法到rtl的代碼實(shí)現(xiàn);
2、負(fù)責(zé)rtl代碼在fpga平臺(tái)的初步驗(yàn)證;
任職要求:
1、微電子與固體電子學(xué)專業(yè)、計(jì)算機(jī)相關(guān)專業(yè),本科以上學(xué)歷;
2、1年以上使用verilog語(yǔ)言進(jìn)行電路設(shè)計(jì)經(jīng)驗(yàn),掌握vcs, design compiler, prime time等eda工具;
3、熟悉asic設(shè)計(jì)開發(fā)流程,具有功能驗(yàn)證,時(shí)序分析的'相關(guān)經(jīng)驗(yàn);
4、熟悉altera/xilinx fpga及其設(shè)計(jì)開發(fā)工具,能夠?qū)?shù)字代碼進(jìn)行fpga的驗(yàn)證;
5、加分項(xiàng):熟悉pcie接口協(xié)議,ecc算法。
集成電路崗位職責(zé)6
崗位職責(zé)
1.負(fù)責(zé)數(shù)字電路的規(guī)格定義、rtl代碼編寫、驗(yàn)證、綜合、時(shí)序分析、可測(cè)性設(shè)計(jì)；
2.負(fù)責(zé)進(jìn)行電路設(shè)計(jì)、仿真以及總體布局和修改；
3.制作ic芯片功能說明書；
4.負(fù)責(zé)芯片的'開發(fā)和設(shè)計(jì)工作；
5.負(fù)責(zé)與版圖工程師協(xié)作完成版圖設(shè)計(jì)，提供技術(shù)支持；
6.及時(shí)編寫各種設(shè)計(jì)文檔和標(biāo)準(zhǔn)化資料，實(shí)現(xiàn)資源、經(jīng)驗(yàn)共享。
崗位要求
1.有扎實(shí)的電路基礎(chǔ)知識(shí)，有一定的集成電路工藝基礎(chǔ)，有較強(qiáng)的電路分析能力；
2.熟悉eda的電路設(shè)計(jì)、版圖設(shè)計(jì)及模擬工具；
3.熟悉模擬集成電路設(shè)計(jì)流程和設(shè)計(jì)方法；
4.熟悉模擬集成電路基本構(gòu)造模塊如adc/dac，pll，bandgap，op-amp，comparator，buffer等；
5.能夠設(shè)計(jì)相應(yīng)的集成電路；
6.具有團(tuán)隊(duì)合作能力，解決問題能力強(qiáng)。
發(fā)展方向
可向以下方向發(fā)展：
1.技術(shù)經(jīng)理
2.電子技術(shù)研發(fā)工程師
3.it項(xiàng)目經(jīng)理
集成電路崗位職責(zé)7
模擬集成電路設(shè)計(jì)工程師 南京華訊方舟通信設(shè)備有限公司 南京華訊方舟通信設(shè)備有限公司,南京華訊,南京華訊方舟,南京華訊
1、根據(jù)設(shè)計(jì)指標(biāo)設(shè)計(jì)bg、ldo、opa、comparator等基本電路;
2、根據(jù)系統(tǒng)要求參與設(shè)計(jì)pll、adc、dac、filter、vga等系統(tǒng);
3、根據(jù)電路要求配合版圖工程師完成相應(yīng)版圖的設(shè)計(jì);
4、根據(jù)電路設(shè)計(jì)結(jié)果完成設(shè)計(jì)文檔的編寫以及制定相應(yīng)的.測(cè)試計(jì)劃;
5、配合測(cè)試工程師完成相應(yīng)模塊的測(cè)試,并根據(jù)測(cè)試數(shù)據(jù)進(jìn)行性能評(píng)估以及問題分析;
職位要求:
1、本科以上微電子、電子工程、電子信息等專業(yè);
2、具備兩年以上模擬集成電路設(shè)計(jì)經(jīng)驗(yàn);
3、對(duì)運(yùn)放、比較器、帶隙基準(zhǔn)等基本模塊的原理有比較深刻的認(rèn)識(shí);
4、有pll/adc/dac/filter/ldo等模塊設(shè)計(jì)經(jīng)驗(yàn)優(yōu)先;
5、熟悉使用cadence virtuoso集成電路設(shè)計(jì)平臺(tái);
6、良好的團(tuán)隊(duì)合作精神,工作敬業(yè)負(fù)責(zé)。
集成電路崗位職責(zé)8
職責(zé)描述:
1. 參與產(chǎn)品架構(gòu)設(shè)計(jì)
2. 按照產(chǎn)品定義完成ip設(shè)計(jì)及系統(tǒng)設(shè)計(jì)
3. 配合fpga進(jìn)行系統(tǒng)調(diào)試
4. 參與數(shù)字電路的仿真驗(yàn)證
5. 參與芯片的數(shù)字流程
6. 編寫ip及產(chǎn)品文檔
任職要求:
1. 電子工程,計(jì)算機(jī)或微電子等專業(yè),本科以上學(xué)歷
2. 在數(shù)字設(shè)計(jì)領(lǐng)域有2年以上工作經(jīng)驗(yàn)
3. 熟悉verilog hdl語(yǔ)言,熟悉arm,amba總線及常用ip的'原理
4. 熟悉常用的eda工具,理解芯片時(shí)序以及測(cè)試概念
5. 具有arm或者mcu項(xiàng)目經(jīng)驗(yàn)者優(yōu)先
6. 具有團(tuán)隊(duì)精神,責(zé)任感,積極主動(dòng),溝通能力強(qiáng)
集成電路崗位職責(zé)9
數(shù)字集成電路后端設(shè)計(jì)
工作職責(zé):微處理器,存儲(chǔ)器控制,和芯片外設(shè)接口等后端設(shè)計(jì),40-180nm工藝。
要求:
1、熟悉數(shù)字電路后端設(shè)計(jì)全流程,包含pr,cts,sta,power analysis 等。
2、5年以上后端設(shè)計(jì)經(jīng)驗(yàn)
工作職責(zé):微處理器,存儲(chǔ)器控制,和芯片外設(shè)接口等后端設(shè)計(jì),40-180nm工藝。
要求:
1、熟悉數(shù)字電路后端設(shè)計(jì)全流程,包含pr,cts,sta,power analysis 等。
2、5年以上后端設(shè)計(jì)經(jīng)驗(yàn)
集成電路崗位職責(zé)10
職責(zé)描述:
1、與芯片設(shè)計(jì)工程師溝通,撰寫完整的ip驗(yàn)證和芯片級(jí)驗(yàn)證的'測(cè)試計(jì)劃。
2、負(fù)責(zé)芯片測(cè)試環(huán)境搭建。
3、使用system verilog搭建uvm驗(yàn)證環(huán)境。能進(jìn)行隨機(jī)性測(cè)試和回歸測(cè)試。
4、參與fpga系統(tǒng)驗(yàn)證。
任職要求:
1、電子工程,計(jì)算機(jī)或微電子等專業(yè),本科以上學(xué)歷。
2、在數(shù)字設(shè)計(jì)驗(yàn)證領(lǐng)域有2年以上工作經(jīng)驗(yàn)。
3、熟悉ip模塊以及芯片級(jí)測(cè)試計(jì)劃的撰寫。
4、熟悉verilog/c/c++。
5、熟悉uvm驗(yàn)證方法學(xué),熟悉使用system verilog。
6、具有芯片流片經(jīng)驗(yàn)者優(yōu)先。
7、有低功耗驗(yàn)證者優(yōu)先。
8、具有團(tuán)隊(duì)精神,責(zé)任感,積極主動(dòng),溝通能力強(qiáng)。
集成電路崗位職責(zé)11
崗位職責(zé)
1)根據(jù)fpga芯片中各功能模塊如serdes等要求，書寫驗(yàn)證方案，制定驗(yàn)證計(jì)劃。
2)維護(hù)和搭建驗(yàn)證環(huán)境，執(zhí)行/調(diào)試/分析回歸驗(yàn)證和覆蓋率收集，以及開發(fā)腳本提升驗(yàn)證效率。
崗位要求:
1)大學(xué)本科及以上學(xué)歷，電子工程、通信、微電子或相關(guān)專業(yè)。
2)熟練使用verilog，systemverilog，熟悉uvm仿真環(huán)境以及面向?qū)ο蟮脑O(shè)計(jì)方法。
3)熟悉數(shù)字集成電路前端后端仿真驗(yàn)證。
4)熟悉腳本語(yǔ)言的使用，如perl，python，shell，makefile等
5)優(yōu)先考慮具有serdes協(xié)議驗(yàn)證經(jīng)驗(yàn)。
集成電路崗位職責(zé)12
職位信息
1、完成模擬電路設(shè)計(jì)、仿真和驗(yàn)證及相應(yīng)文檔撰寫等工作。
2、協(xié)助完成相關(guān)電路的實(shí)驗(yàn)室測(cè)試等工作
職位要求
1、熟練掌握混合信號(hào)芯片設(shè)計(jì)流程,掌握基本的模擬電路知識(shí),熟悉器件模型,器件參數(shù)及相關(guān)仿真工具;
2、具有至少兩年模擬集成電路線路設(shè)計(jì)經(jīng)驗(yàn),有相關(guān)帶隙基準(zhǔn),ldo,運(yùn)放等設(shè)計(jì)經(jīng)驗(yàn)者優(yōu)先;
3、具有良好的動(dòng)手能力和溝通能力。 職位信息
1、完成模擬電路設(shè)計(jì)、仿真和驗(yàn)證及相應(yīng)文檔撰寫等工作。
2、協(xié)助完成相關(guān)電路的實(shí)驗(yàn)室測(cè)試等工作
職位要求
1、熟練掌握混合信號(hào)芯片設(shè)計(jì)流程,掌握基本的`模擬電路知識(shí),熟悉器件模型,器件參數(shù)及相關(guān)仿真工具;
2、具有至少兩年模擬集成電路線路設(shè)計(jì)經(jīng)驗(yàn),有相關(guān)帶隙基準(zhǔn),ldo,運(yùn)放等設(shè)計(jì)經(jīng)驗(yàn)者優(yōu)先;
3、具有良好的動(dòng)手能力和溝通能力。
集成電路崗位職責(zé)13
職責(zé)描述:
1、參與數(shù)字集成電路模塊設(shè)計(jì)和驗(yàn)證工作;
2、根據(jù)模塊規(guī)格要求,完成數(shù)字電路模塊詳細(xì)設(shè)計(jì);負(fù)責(zé)所設(shè)計(jì)模塊基本功能驗(yàn)證;
3、負(fù)責(zé)前端設(shè)計(jì)工作,包括電路綜合、時(shí)序檢查、形式驗(yàn)證等;
4、對(duì)模塊集成、驗(yàn)證、測(cè)試和調(diào)試提供技術(shù)支持。
任職要求:
1、微電子專業(yè)本科以上學(xué)歷,有成功的數(shù)字集成電路設(shè)計(jì)開發(fā)經(jīng)歷優(yōu)先;
2、理解數(shù)字集成電路的設(shè)計(jì)驗(yàn)證技術(shù)和流程;
3、掌握數(shù)字信號(hào)處理基本原理及數(shù)字實(shí)現(xiàn)方法,包括數(shù)字濾波器,采樣變換,調(diào)制編碼等;
4、熟練使用linux/unix操作系統(tǒng),熟悉vhdl/verilog等工具語(yǔ)言;
5、熟悉數(shù)字ic設(shè)計(jì)流程,熟練掌握synopsys或cadence eda工具;
6、通信協(xié)議和標(biāo)準(zhǔn)有一定的了解優(yōu)先;
7、有數(shù)字驗(yàn)證,dft或數(shù)字后端設(shè)計(jì)經(jīng)驗(yàn)的.優(yōu)先;
8、良好的團(tuán)隊(duì)合作精神及技術(shù)學(xué)習(xí)能力。具備較強(qiáng)動(dòng)手能力。
集成電路崗位職責(zé)14
崗位描述:
能獨(dú)立進(jìn)行數(shù)字ip的設(shè)計(jì)開發(fā)工作，按開發(fā)流程進(jìn)行模塊開發(fā)并按要求輸出:概要設(shè)計(jì)，詳細(xì)設(shè)計(jì)，代碼等工作產(chǎn)物。解決開發(fā)過程出現(xiàn)的相關(guān)問題，并能夠?qū)λ惴▽?shí)現(xiàn)進(jìn)行優(yōu)化。
崗位職責(zé):
1、參與模塊前端設(shè)計(jì)工作，包括ip集成、模塊設(shè)計(jì)、子系統(tǒng)仿真;
2、負(fù)責(zé)模塊的優(yōu)化，參與制定ip規(guī)格，編寫相關(guān)文檔;
3、負(fù)責(zé)將開發(fā)工作產(chǎn)物(設(shè)計(jì)文檔、代碼等文件)上傳git服務(wù)器;
4、配合驗(yàn)證人員完成模塊驗(yàn)證;
5、配合fpga開發(fā)人員完成fpga驗(yàn)證;
6、負(fù)責(zé)與測(cè)試人員和客戶溝通相關(guān)開發(fā)需求和功能;
7、每周提交周報(bào)到經(jīng)理和所在項(xiàng)目的pm和pl;
8、完成上級(jí)布置的其它工作。
崗位要求:
1、應(yīng)知應(yīng)會(huì):代碼設(shè)計(jì)規(guī)范、代碼編碼規(guī)范、代碼發(fā)布流程
2、專業(yè)技能:
熟練掌握verilog hdl語(yǔ)言;
熟練掌握數(shù)字電路設(shè)計(jì)流程及方法;
對(duì)邏輯綜合、時(shí)序收斂、形式驗(yàn)證等數(shù)字前端設(shè)計(jì)方法有一定了解;
對(duì)fpga實(shí)現(xiàn)有一定的了解;
熟悉perl、python、shell、tcl等腳本語(yǔ)言;
對(duì)密碼算法有一定的了解;
具有一定的`技術(shù)文檔編寫能力，能獨(dú)立編制模塊的用戶手冊(cè)、集成手冊(cè)等。
3、工具使用:
熟練使用dc、vcs、verdi等ic設(shè)計(jì)前端eda工具;
熟練使用版本管理軟件(git、svn等);
熟練使用office(word、excel、powerpoint)等各種辦公軟件。
4、具有較強(qiáng)的再學(xué)習(xí)能力;能熟練閱讀英文技術(shù)資料，能進(jìn)行英文書面和口語(yǔ)交流。
5、良好的語(yǔ)言、書面表達(dá)和溝通能力;主動(dòng)性和團(tuán)隊(duì)協(xié)作意識(shí)。
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